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编者按：WAIC 2026上，两个容易被忽略的信号值得放在一起看：业界首个RISC-V AI算力超节点方案首秀，突破万卡集群算力墙；东方算芯DF1000获SAIL奖，用"软件定义+3D近存计算"绕开先进制程。当EUV光刻机仍是禁区，中国算力正在用架构创新换道超车——不靠制程碾压，靠架构突围。
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中国半导体有一个绕不开的困境：先进制程被卡，EUV光刻机进不来。
但WAIC 2026上出现的两个信号，指向了同一条出路——不靠制程碾压，靠架构创新。
信号一：RISC-V杀入AI算力主战场
7月18日WAIC现场，业界首个RISC-V AI算力超节点方案首秀，突破万卡集群算力墙。
这件事的意义被严重低估了。
过去RISC-V的标签是"嵌入式""MCU""物联网"——做做手表芯片、家电控制芯片没问题，但AI训练推理？那是英伟达GPU和ARM服务器CPU的地盘。RISC-V能上AI算力主战场？
这次超节点首秀给出的回答是：能。
RISC-V的优势在于开源免费、指令集可定制。没有ARM的授权费和生态限制，也没有x86的专利壁垒。在AI算力需求爆发、传统架构授权成本高企的背景下，RISC-V从"边缘计算"切入"AI核心"是一条逻辑自洽的路径。
数据佐证这一趋势：中国RISC-V产业产值约1700亿元（+35%），出货量30亿颗占全球半壁江山。阿里玄铁C950刷新全球RISC-V性能纪录，SPECint2006突破70分对标ARM A76；进迭时空K3 AI算力提升30倍，可本地运行300-800亿参数大模型。
从MCU到AI算力超节点，RISC-V正在完成一次赛道升级。
信号二：3D近存计算绕开制程墙
同一个WAIC上，东方算芯首次公开展出全球首颗软件定义近存计算3D AI芯片DF1000，获2026 SAIL奖。
DF1000的路线很有意思：基于国内成熟工艺（非先进制程），采用"软件定义+3D堆叠近存计算"，DRAM-LOGIC融合架构。
翻译成大白话：既然7nm以下做不了，那就把内存和计算单元叠在一起，让数据不用跑远路，用3D堆叠和近存计算来弥补制程劣势。
这是一条绕开EUV的务实路径。先进制程被卡，但3D封装、先进封装国内并非空白。用封装工艺换制程工艺，用架构设计换晶体管密度——DF1000代表的正是这种"换道"思维。
软件定义则是另一个亮点：硬件不变，靠软件重新配置计算逻辑，一颗芯片适配多种AI模型。这降低了流片成本，也提高了芯片复用率。
换道超车的底层逻辑
把两个信号放在一起，能看到一条清晰的逻辑链：
问题：先进制程被卡，传统"制程碾压"路径走不通。
解法：从制程竞争转向架构竞争。RISC-V用开源指令集打破授权壁垒，3D近存计算用封装创新弥补制程差距，软件定义用灵活配置提升芯片效率。
本质：当摩尔定律的"纵向缩放"（制程微缩）受阻，产业转向"横向缩放"（架构创新、封装创新、系统创新）。
这不是一家两家企业的选择，而是整个中国算力产业的集体转向。从鹏城云脑的系统级整合，到RISC-V超节点的架构突围，到DF1000的近存计算创新——中国算力正在从"追进制程"转向"比架构"。
一个判断：换道不等于超车
方向是对的，但别急着喊"超车"。
RISC-V超节点从首秀到规模化部署，中间隔着生态成熟度、软件栈适配、实际算力效率等多重考验。DF1000从SAIL奖到量产交付，也需要经过现网验证。换道只是找到了一条新路径，能不能跑通、跑多快，取决于生态建设的速度。
但至少有一点可以确定：当制程这条路被堵死，中国算力没有停下，而是找到了新的跑道。这比原地等待更值得期待。
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