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作者：晨晞
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这不是某个实验室的 demo，而是一个已经嵌入全球最大 EDA 工具链的商业产品。该AI超级智能体适配芯片全流程设计验证工作，可搭配Cadence Xcelium逻辑仿真、Jasper形式验证工具开展动态仿真测试。
目前英伟达工程师已规模化应用该方案，可将传统五周的芯片RTL验证周期缩短至一天以内，验证效率提升40倍以上，大幅优化复杂半导体设计的研发节奏。AI 自己跑仿真、做形式化验证、发现设计缺陷、修复代码 bug，整个过程自驱动，人类工程师只需要在关键节点审核确认。
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ChipStack AI 的进化史
ChipStack 不是 Cadence 自己从零孵化的项目。2023 年，Kartik Hegde 从 AI2 孵化器出来，在西雅图创办了 ChipStack，专注用 AI Agent 做芯片验证。团队只有 20 人，拿了 AI2 和 Khosla Ventures 等机构的 700 万美元融资。
2025 年 11 月，Cadence 收购了这家公司。Hegde 带着团队搬进 Cadence 加州总部。四个月后，ChipStack AI Super Agent 在 CadenceLIVE 2026 上首次亮相。又过了两个月，它就宣布达到了 L5，从被收购到宣称 L5，不到 7 个月。
速度之快，背后是 Cadence 对"Agent 化"这条路线的坚定押注。同期发布的 ViraStack（仿真）和 InnoStack（数字实现/签核），构成了覆盖验证-仿真-实现的完整 AI Agent 产品矩阵。
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L1-L5意味着什么？
EDA 行业给 AI 定义了五个自治等级，类似自动驾驶：
L5 的核心区别在于：不是"AI 建议人来做"，而是"AI 自己做完，人来审核"。
具体到 ChipStack，它的 L5 工作流是这样的：
1. Codex（总指挥）接收设计需求
2. ChipStack 启动 RTL 验证循环
3. Nemotron 大模型作为推理引擎驱动决策
4. OpenShell 沙箱提供安全隔离的执行环境
5. 调度多个专家子 Agent：RTL 生成、测试平台创建、回归测试、调试
6. 用 Cadence Xcelium 跑数百次仿真、Jasper 做形式化验证
7. 发现 bug → 自动定位 → 自动修复 → 重新验证
整个过程自驱动。人类可以在任何环节介入，但不是必须的。值得注意的是，验证恰恰是芯片设计中最适合多 Agent 协作的环节验证天然需要多个专业化 Agent 编排，而 RTL 生成只需要单个 Agent。ChipStack 选择验证作为 L5 的切入点，不是偶然。
相较于传统AI辅助工具，Level-5级别的ChipStack AI Super Agent无需分步指令，可自主评估结果、迭代决策，独立完成规格解读、RTL生成、验证规划、仿真调试、设计收敛等全链条工作。
工程师角色从繁琐的实操执行，转变为进度监督与目标引导，同时工具兼容Codex、Claude Code等平台，全程流程透明、可协作、可核查。
在工程精度与安全保障上，该智能体深度绑定Cadence物理级高精度设计验证引擎，所有AI操作均基于成熟可信的计算模型，保障量产级设计精度。
同时依托NVIDIA OpenShell沙箱运行环境，通过权限隔离、策略管控、数据分级访问等机制，严格保护芯片核心知识产权，实现AI自主工作流的合规安全落地。
NVIDIA表示，此次合作将可控自主能力引入芯片研发流程，兼顾研发提速与数据安全，为高端半导体设计验证提供了可靠新路径。Cadence也持续迭代AI代理产品矩阵，已布局多场景AI超级智能体及AgentStack编排框架，持续推进芯片设计全流程智能化升级。
据悉，ChipStack AI Super Agent与AgentStack编排框架的Level-5自主能力，将于2026年下半年面向早期客户开放体验。
ChipStack 达到 L5，与其说是一个产品的里程碑，不如说是一个信号：EDA 正在从"软件工具"变成"AI 操作系统"。
就像智能手机时代，用户关心的不是底层芯片是什么品牌，而是 App 体验好不好。未来的芯片设计工程师关心的可能不是用 Cadence 还是 Synopsys，而是哪个 AI Agent 更聪明、更可靠。
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